pcb设备工程师
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pcb版图工程师
教育背景
广东工业大学
一本省属重点
电子信息工程 本科
广州2016年8月 - 2020年5月
相关课程：电路分析、信号完整性、PCB设计基础。
技能
Cadence Allegro
Altium Designer
高速信号布线
叠层与阻抗设计
EMC整改
Mentor Xpedition
荣誉奖项
公司年度优秀员工
志愿服务经历
电子设计竞赛技术指导
母校电子协会
广州2023年1月 - 至今
- 为在校学生提供PCB设计指导，累计辅导3支参赛队伍完成作品。
课外活动
校电子设计协会
硬件设计组/技术负责人
广州2018年8月 - 2020年5月
- 组织协会PCB设计培训与竞赛，带领团队获省级电子设计竞赛二等奖。
个人总结
6年PCB版图设计经验，专注高速数字与电源类多层板Layout，熟练使用Cadence Allegro、Altium Designer及Mentor Xpedition。主导过多款8至16层服务器与工控主板设计，一次投板成功率95%以上。熟悉DDR、PCIe、USB等高速信号完整性约束与EMC整改，能独立完成从叠层规划到Gerber输出的全流程。
工作经历
深圳市联创电子科技有限公司
深圳
消费电子ODM
PCB版图工程师
2022年9月 - 至今
Cadence Allegro高速信号
- 负责服务器主板8至16层Layout设计，独立完成叠层规划与阻抗控制，一次投板成功率达95%以上。
- 主导DDR4与PCIe高速信号布线优化，通过等长与参考平面调整将信号眼图裕量提升约20%。
- 配合硬件与结构团队完成EMC整改，缩短样机调试周期约2周，保障项目按期量产。
东莞恒信通信设备有限公司
东莞
通信设备硬件制造
PCB Layout工程师
2020年7月 - 2022年8月
Altium Designer封装库建设
- 承担通信模块4至8层板Layout，完成器件布局与电源分割，月均交付3款板卡设计。
- 建立公司内部封装库与设计规范，减少重复建库工时约30%，降低设计返工率。
项目经验
16层服务器主板Layout项目
2024年3月 - 2024年5月
版图设计负责人
- 负责16层板叠层与阻抗设计，完成DDR4、PCIe Gen4等高速总线布线，满足SI仿真约束。
- 通过电源平面优化与去耦电容布局调整，将核心电源纹波降低约15%，一次投板通过。
工控主板EMC整改项目
2022年12月 - 2023年2月
PCB版图工程师
- 针对辐射超标问题调整地平面分割与关键信号走线，整改后通过Class B认证测试。
- 输出EMC设计检查清单，被团队沿用至后续5款产品，减少同类问题重复出现。
主要成就
投板成功率提升
连续两年主导项目一次投板成功率达95%以上，高于团队平均水平。
信号质量优化
高速总线布线优化使眼图裕量提升约20%，支撑产品按期量产。
规范沉淀
牵头建立封装库与设计规范，降低重复建库工时约30%。
其他信息
到岗时间:
离职状态，一周内可到岗。
出差意愿:
可接受短期出差与驻厂支持。
证书与认证
PCB设计工程师（中级） - 中国电子学会
2021年6月
证明PCB设计与Layout专业能力。
Altium Designer认证工程师 - Altium
2020年9月
证明EDA工具应用能力。
语言能力
英语（CET-4）可阅读英文器件手册与设计规范
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