高速PCB设计工程师
高速PCB设计工程师
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PCB Layout专家
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个人总结
10年PCB Layout经验，精通高速数字电路布局布线，熟练使用Allegro、PADS等工具。擅长信号完整性与电源完整性优化，主导过多款服务器和通信产品PCB设计并量产。具备团队协作和项目管理能力，注重设计质量与成本控制。
工作经历
华为技术有限公司
深圳
通信设备500强
PCB Layout专家
2019年3月 - 2024年6月
高速数字Allegro
- 负责服务器主板PCB Layout，完成10+个项目布局布线，全部按期交付。
- 通过优化层叠和布线规则，将信号完整性裕量提升15%，减少后期改版次数。
- 主导团队设计规范制定，提升团队整体设计效率20%。
中兴通讯股份有限公司
上海
通信设备上市公司
PCB Layout工程师
2014年7月 - 2019年2月
PADS通信产品
- 负责通信产品PCB设计，完成5款产品布局布线，均实现量产。
- 引入仿真驱动设计流程，将设计一次成功率提升30%。
项目经验
高性能服务器主板PCB设计
2022年3月 - 2023年12月
PCB Layout负责人
- 负责16层服务器主板PCB布局布线，通过优化参考平面和过孔设计，将关键信号眼图裕量提升20%。
- 主导电源完整性仿真与优化，将核心电压纹波控制在2%以内，一次通过硬件测试。
主要成就
信号完整性提升
主导服务器主板PCB布局优化，将信号完整性裕量提升25%，一次性通过EMC测试。
成本优化
通过层叠优化和布线策略改进，将10层板平均成本降低12%。
证书与认证
高速电路设计工程师 - 中国电子学会
2021年6月
证明高速数字电路设计与信号完整性分析能力。
Cadence Allegro认证工程师 - Cadence
2019年12月
证明PCB设计工具高级应用能力。
语言能力
英语（CET-6）可阅读英文技术文档并进行简单口语交流
教育背景
电子科技大学
985211
电子信息工程 本科
成都2010年9月 - 2014年6月
主修课程：高频电子线路、信号完整性分析、PCB设计基础。
技能
Allegro
PADS
信号完整性仿真
电源完整性
高速数字电路
EMC设计
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