pcb设备工程师
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PCB Layout资深工程师
技能
Cadence Allegro
PADS
Altium Designer
高速信号布线
电源完整性设计
EMC整改
教育背景
华中科技大学
985211
电子信息工程 本科
武汉2014年9月 - 2018年6月
主修课程：电路分析、信号与系统、电磁场与微波技术。
华中科技大学
985双一流
电子信息工程 硕士
武汉2018年9月 - 2020年6月
研究方向：高速电路信号完整性分析。
荣誉奖项
校级一等奖学金
年度优秀技术员工
志愿服务经历
PCB设计技术分享志愿者
深圳市电子行业协会
深圳2023年3月 - 至今
- 为电子工程专业学生讲解PCB设计基础与职业发展路径。
课外活动
电子设计协会
电子设计协会/技术部部长
武汉2018年9月 - 2019年6月
- 组织校内PCB设计竞赛，带领团队完成赛题设计与评审。
个人总结
8年PCB Layout经验，专注高速数字与电源类多层板设计，熟练使用Cadence Allegro、PADS及Altium Designer。主导服务器主板、通信设备等10余款产品从布局布线到量产交付，熟悉SI/PI仿真与EMC整改。具备完整的高速信号完整性与电源完整性设计能力，可独立承担复杂项目。
工作经历
深圳华芯电子科技有限公司
深圳
通信设备上市公司
PCB Layout资深工程师
2021年4月 - 至今
高速数字板Cadence Allegro
- 负责服务器主板及通信模块的PCB Layout，完成12层以上高速板布局布线，一次投板成功率提升至95%。
- 主导DDR4与PCIe Gen4高速信号布线优化，通过仿真整改将信号眼图裕量提升20%。
- 参与EMC整改与量产问题分析，推动3款产品顺利通过认证并批量交付。
深圳联创通信技术有限公司
深圳
通信设备民营
PCB Layout工程师
2020年7月 - 2021年3月
电源板PADS
- 承担通信设备电源板与背板Layout设计，完成8层板布线并缩短设计周期15%。
- 配合硬件工程师完成电源完整性优化，降低纹波噪声并提升整机稳定性。
项目经验
服务器主板高速PCB设计项目
2022年3月 - 2023年12月
PCB Layout负责人
- 负责服务器主板高速信号布局布线，完成DDR4与PCIe Gen4通道设计，满足信号完整性要求。
- 通过SI仿真优化走线与叠层，将关键信号裕量提升20%，一次投板成功。
通信设备背板Layout优化项目
2021年6月 - 2022年2月
PCB Layout工程师
- 主导通信设备背板Layout设计，完成多层板电源与信号分区布线。
- 配合EMC整改，优化接地与滤波布局，使产品顺利通过认证测试。
主要成就
高速信号裕量提升
通过叠层与布线优化，将关键高速信号裕量提升20%。
设计周期缩短
优化设计流程，将单板Layout周期缩短15%。
证书与认证
电子设计工程师（中级） - 中国电子学会
2022年6月
证明高速电路设计与信号完整性分析能力。
PCB设计工程师（高级） - 工业和信息化部
2021年11月
证明PCB设计软件高级应用能力。
语言能力
英语（CET-6）可阅读英文器件手册与技术文档
其他信息
到岗时间:
可接受短期出差，一个月内到岗。
驾照:
C1驾照，可配合客户现场支持。
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