fpga逻辑开发工程师
fpga逻辑开发工程师
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fpga测试工程师
教育背景
西安电子科技大学
211双一流
微电子科学与工程 本科
西安2017年9月 - 2021年6月
主修数字电路、FPGA设计与验证、信号完整性。
技能
Verilog/SystemVerilog
Vivado/Quartus
ModelSim仿真
Python自动化脚本
示波器/逻辑分析仪
时序分析与调试
荣誉奖项
校级一等奖学金
全国大学生集成电路创新创业大赛
志愿服务经历
科技科普志愿者
西安电子科技大学青年志愿者协会
西安2020年3月 - 2020年12月
- 为社区青少年讲解数字电路与FPGA入门知识，累计授课8次。
课外活动
大学生电子设计协会
大学生电子设计协会/技术部部长
西安2019年9月 - 2021年5月
- 组织FPGA开发板培训与校内竞赛，累计培训学员60余人。
个人总结
4年FPGA测试与验证经验，熟悉Xilinx、Altera平台，能独立完成测试方案设计、用例编写与自动化回归。熟练使用Vivado、ModelSim、Verilog及Python脚本，主导过高速接口与通信模块验证。注重缺陷闭环与测试效率提升。
工作经历
深圳市芯联微电子有限公司
深圳
芯片设计专精特新
FPGA测试工程师
2023年4月 - 至今
FPGA验证自动化测试
- 负责通信基带FPGA模块测试，编写用例300余条，版本回归周期由5天缩短至2天。
- 搭建基于Python的自动化回归脚本，覆盖率达85%，累计发现并闭环缺陷120余个。
- 参与高速接口时序验证，定位并推动修复SerDes链路误码问题，良率提升3%。
西安华芯电子科技有限公司
西安
集成电路高新技术企业
FPGA测试工程师
2021年7月 - 2023年3月
ModelSim功能测试
- 承担图像处理FPGA模块功能测试，完成200余条用例设计与执行，交付零重大缺陷。
- 使用ModelSim搭建仿真环境，将模块级验证覆盖率由70%提升至92%。
项目经验
高速DDR3接口FPGA验证项目
2024年1月 - 2024年6月
测试负责人
- 负责DDR3接口读写测试方案设计与用例编写，覆盖边界与异常场景。
- 通过逻辑分析仪定位时序违例，推动设计修改后误码率降至1e-12以下。
FPGA自动化回归平台建设
2023年6月 - 2023年12月
核心开发
- 搭建基于Python的自动化回归平台，实现用例批量执行与报告自动生成。
- 回归效率提升60%，单版本测试人力投入由3人日降至1人日。
主要成就
回归测试效率提升
主导搭建自动化回归测试框架，单轮回归时间缩短约40%，已在团队内推广使用。
缺陷闭环质量保障
累计提交并推动修复FPGA相关缺陷80余项，关键模块缺陷逃逸率低于2%。
证书与认证
集成电路工程技术人员（中级） - 工业和信息化部
2022年11月
证明数字电路设计与验证能力。
嵌入式系统工程师 - 中国电子学会
2021年9月
证明嵌入式系统开发基础能力。
其他信息
到岗时间:
可接受短期出差，一个月内到岗。
语言能力:
CET-6，可阅读英文芯片手册与规范。
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