fpga逻辑开发工程师
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航空航天FPGA工程师
教育背景
西安电子科技大学
211双一流
电子科学与技术 硕士
西安2018年9月 - 2021年6月
研究方向：数字信号处理与可编程逻辑设计。
西安理工大学
省属重点卓越工程师计划
电子信息工程 本科
西安2014年9月 - 2018年6月
主修课程：数字电路、信号与系统、FPGA设计基础。
技能
Verilog/VHDL
Xilinx Vivado
时序约束与静态时序分析
高速接口（SRIO/PCIe/Aurora）
Zynq SoC软硬协同
MATLAB/Simulink算法建模
荣誉奖项
中国航天科技集团技术改进三等奖
西安电子科技大学优秀硕士毕业生
个人简历
展现专业实力，创造职场价值。
个人总结
5年航空航天领域FPGA开发经验，主导星载与弹载信号处理板卡逻辑设计，熟悉Xilinx Zynq、Kintex平台及GJB设计规范。精通Verilog/VHDL、时序约束与高速接口调试，具备完整的从方案设计到单机交付经验。累计交付3型产品，一次流片成功率100%。
工作经历
西安某航天电子技术研究所
西安
航天科研院所GJB体系
FPGA逻辑设计工程师
2022年9月 - 至今
FPGA逻辑设计Zynq
- 负责星载信号处理板卡FPGA逻辑架构设计，完成Zynq平台软硬协同方案，单板处理时延降低35%。
- 主导高速SRIO与Aurora接口调试，解决跨时钟域数据丢包问题，链路误码率降至1e-12以下。
- 编写GJB相关设计文档与测试大纲，支撑3型产品顺利通过环境试验与单机验收。
西安某导航技术有限公司
西安
卫星导航民营企业
FPGA开发工程师
2020年7月 - 2022年8月
基带信号处理仿真验证
- 参与北斗导航基带信号处理FPGA模块开发，完成捕获跟踪逻辑实现，捕获时间缩短20%。
- 搭建基于Vivado的仿真验证平台，用例覆盖率达90%，有效降低后期联调返工率。
项目经验
星载多通道数据采集与处理板卡
2024年3月 - 2024年5月
FPGA负责人
- 基于Kintex-7完成8通道AD采集与实时滤波逻辑设计，采样率200MSPS，资源占用率控制在75%以内。
- 设计DDR3缓存与SRIO回传链路，实现数据零丢失传输，支撑整星在轨稳定运行超12个月。
弹载信号处理单机FPGA国产化替代
2022年12月 - 2023年2月
逻辑设计工程师
- 完成进口FPGA到国产器件的逻辑移植与约束重构，功能一致性验证通过率100%。
- 优化关键路径时序，将工作频率由150MHz提升至200MHz，满足型号指标要求。
研究经历
高速数字信号处理算法FPGA实现研究/研究助理
西安
电子工程学院
2020年1月 - 2020年6月
- 研究多相滤波与FFT算法在FPGA上的流水线实现方法，完成原型验证并发表核心期刊论文1篇。
- 搭建MATLAB与Vivado联合仿真流程，将算法验证周期由2周缩短至3天。
其他信息
到岗时间:
在职，确认录用后一个月内到岗，可接受短期出差与试验外场任务。
保密资质:
持有国防科技工业相关保密培训合格证明，熟悉涉密项目管理流程。
证书与认证
FPGA工程师（中级） - 工业和信息化部教育与考试中心
2022年6月
证明FPGA设计与开发专业能力。
全国计算机等级考试三级（嵌入式技术） - 教育部教育考试院
2019年3月
证明嵌入式系统开发基础能力。
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